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acex1k

  • 147497_ALTERA_acex1k.pdf介绍alter acex1k系列芯片

    147497_ALTERA_acex1k.pdf介绍alter acex1k系列芯片

    标签: ALTERA_ACEX 147497 acex1k alter

    上传时间: 2013-12-19

    上传用户:talenthn

  • 基于FPGA的数字化调频DDS系统设计

    频率合成技术广泛应用于通信、航空航天、仪器仪表等领域。目前,常用的频率合成技术有直接式频率合成,锁相频率合成和直接数字频率合成(DDS)。本次设计是利用FPGA完成一个DDS系统并利用该系统实现模拟信号的数字化调频。 DDS是把一系列数字量形式的信号通过D/A转换形成模拟量形式的信号的合成技术。主要是利用高速存储器作查寻表,然后通过高速D/A转换器产生已经用数字形式存入的正弦波(或其他任意波形)。一个典型的DDS系统应包括:相位累加器,可在时钟的控制下完成相位的累加;相位码—幅度码转换电路,一般由ROM实现;DA转换电路,将数字形式的幅度码转换成模拟信号。DDS系统可以很方便地获得频率分辨率很精细且相位连续的信号,也可以通过改变相位字改变信号的相位,因此也广泛用于数字调频和调相。本次数字化调频的基本思想是利用AD转换电路将模拟信号转换成数字信号,同时用该数字信号与一个固定的频率字累加,形成一个受模拟信号幅度控制的频率字,从而获得一个频率受模拟信号的幅度控制的正弦波,即实现了调频。该DDS数字化调频方案的硬件系统是以FPGA为核心实现的。使用Altera公司的acex1k系列FPGA,整个系统由VHDL语言编程,开发软件为MAX+PLUSⅡ。经过实际测试,该系统在频率较低时与理论值完全符合,但在高频时,受器件速度的限制,波形有较大的失真。

    标签: FPGA DDS 数字化 调频

    上传时间: 2013-06-14

    上传用户:ljt101007

  • 基于FPGA的嵌入式MCU设计与应用研究

    随着电子技术和信息技术的发展,可编程逻辑器件的应用领域越来越宽。可编程SoC设计已成为SoC设计的新方法。论文介绍了可编程逻辑器件的设计方法和开发技术,并用硬件描述语言和FPGA/CPLD设计技术,探索和研究了基于FPGA的RISCMCU的设计与实现过程。 论文参照Mircochip公司的PICl6C5X单片机的体系结构,设计了8位RISCMCU。该嵌入式MCU设计采用了自顶向下的设计方法和模块化设计思想。MCU总体结构设计划分控制模块、ALU模块、存储模块三大模块。然后,对各模块的具体技术实现细节分别进行了阐述。论文中设计的MCU能实现PICl6C5X单片机33条指令中除OPTION、CLRWDT、SLEEP和TRIS四条指令以外的其余29条指令的功能,但应用是基于FPGA的,能与其他外设IP方便的结合在一起使用,比ASIC的PICl6C57X的应用更具灵活性。 软件仿真和硬件验证表明:所设计的嵌入式MCU在各方面均达到了一定的性能指标,在Altera公司acex1k系列的EPlK30TCl44-3器件上的工作频率达21.88MHz。这些为自主设计R/SCMCU的IP核提供了值得借鉴的探索成果和设计思路,在通用控制领域也有一定的实用价值。 此外,论文中还介绍了三相SPWM控制模块的设计,该模块具有死区时间和载波比任意可调的特点,可以单独应用,也可以作为MCU的外设子模块应用。

    标签: FPGA MCU 嵌入式 应用研究

    上传时间: 2013-07-16

    上传用户:熊少锋

  • 设计并调试好一个能产生”梁祝”曲子的音乐发生器

    设计并调试好一个能产生”梁祝”曲子的音乐发生器,并用EDA实验开发系统(拟采用的实验芯片的型号可选Altera的MAX7000系列的 EPM7128 CPLD ,FLEX10K系列的EPF10K10LC84-3 FPGA, acex1k系列的 EP1K30 FPGA,Xinlinx 的XC9500系列的XC95108 CPLD,Lattice的ispLSI1000系列的1032E CPLD)进行硬件验证。 设计思路 根据系统提供的时钟源引入一个12MHZ时钟的基准频率,对其进行各种分频系数的分频,产生符合某一音乐的频率,然后再引入4HZ的时钟为音乐的节拍控制,最后通过扬声器放出来。

    标签: 调试 音乐发生器

    上传时间: 2013-12-18

    上传用户:阿四AIR

  • 设计并调试好一个VGA彩条信号发生器

    设计并调试好一个VGA彩条信号发生器,并用EDA实验开发系统(拟采用的实验芯片的型号可选Altera的MAX7000系列的 EPM7128 CPLD ,FLEX10K系列的EPF10K10LC84-3 FPGA, acex1k系列的 EP1K30 FPGA,Xinlinx 的XC9500系列的XC95108 CPLD,Lattice的ispLSI1000系列的1032E CPLD)进行硬件验证。 设计思路 由系统提供的时钟源引入扫描信号,根据VGA彩色显示器的工作原理,设计出各种颜色编码和行场扫描信号。将并口线从计算机并口与CPLD/FPGA适配板连接好,然后将VGA接口与彩色显示器连接好,彩条信号就可以在显示器中产生,通过按键可以改变产生彩条的方式,共六种彩条信号,两种横彩条,两种竖彩条,两种棋盘格。本实验运用层次化设计出VGA彩条信号发生器,由行场信号模块模块和彩条信号发生模块构成,彩条信号发生器的顶层原理图如图10.7 所示.

    标签: VGA 调试 信号发生器

    上传时间: 2016-12-27

    上传用户:manking0408