GD32E10x_Demo_Suites_V1.0.1.rar 兆易创新GD32E10x开发资料
上传时间： 2022-05-20
上传用户：sheng199241
兆易创新的SPI FLASH开发指导手册
标签： FLASH GD25S512MD
上传时间： 2022-05-22
上传用户：ttalli
本实验将实现 FPGA 芯片和 PC 之间进行千兆以太网数据通信, 通信协议采用 Ethernet UDP 通信协议。 FPGA 通过 GMII 总线和开发板上的 Gigabit PHY 芯片通信, Gigabit PHY芯片把数据通过网线发给 PC
上传时间： 2022-06-02
上传用户：得之我幸78
ax88179千兆網卡芯片手冊，usb3.0 rj45網卡
上传时间： 2022-06-18
上传用户：tqsun2008
具备GMII接口和ARP协议功能的千兆以太网控制器
上传时间： 2022-06-24
上传用户：2431247090
王兆安《电力电子技术》机械工业出版社讲义_603760
标签： 电力电子技术
上传时间： 2022-07-04
上传用户：13692533910
C6678双千兆网接口设计方案
上传时间： 2022-07-10
上传用户：wwa875
1.深入研究PCIe和千兆以太网，了解PCIe和千兆以太网的技术优势，具体分析PCle和千兆以太网的传输协议，详细说明PCleTLP数据包格式和以太网标2.完成PCIe DMA数据传输系统设计。设计方案主要包括两大部分，分别是FPGA端Verilog逻辑模块开发以及PC端的驱动和C应用程序开发。FPGA端基于PCle IP Core完成了发送接收引擎模块、寄存器读写控制模块和FIFO读写控制模块的设计。定义了相应模块的接口，并分析了数据传输的时序。PC端采用WinDriver进行PCle的驱动开发，并根据WinDriver提供的驱动API函数完成C应用程序的设计。3.完成千兆以太网数据传输系统设计。设计方案也主要包括两大部分，分别是FPGA端Verilog逻辑模块开发以及PC端Winpcap应用程序开发。FPGA端基于嵌入式三态以太网MACIPCore，设计了发送接收引擎模块、FIFO读写控制模块和物理接口模块。定义了相应模块的接口，并分析了数据传输经过Locallink接口和Client用户接口上的传输时序。PC端采用Winpcap提供的网络编程完成了C应用程序的设计，实现了捕获FPGA端发送的数据包以及发送原始数据包至FPGA端的功能。4.PCIe DMA数据传输系统和千兆以太网数据传输系统在Xilinx ML507开发板上进行了性能测试。记录FPGA与PC间进行读写测试的结果，验证这两个系统的可用性和稳定性，最后分析了影响系统传输速率的原因以及系统目前仍存在的不足。
上传时间： 2022-07-11
上传用户：xsr1983
用RTL8367RB打造的五口全千兆交换机（PCB）
上传时间： 2022-07-28
上传用户：qingfengchizhu
关于半桥或全桥自举式浮动栅极驱动的四个中文文档，为飞兆和IR公司技术文档，介绍了自举电路元件的选取及实际问题解决。可从其官网中下载。这里集合上传~
标签： 驱动
上传时间： 2013-07-30
上传用户：碉堡1234
