直接式数字锁相环频率合成器.用ELANIX公司SYSTEMVIEW运行.

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• 直接式数字锁相环频率合成器.用ELANIX公司SYSTEMVIEW运行.免费下载

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  标签： SYSTEMVIEW ELANIX 数字锁相环 频率合成器

  上传时间： 2015-07-18

  上传用户：妄想演绎师

• 小数分频技术解决了锁相环频率合成器中的频率分辨率和转换时间的矛盾, 但是却引入了严重的相位噪声, 传统的相位补偿方法由于对Aö D 等数字器件的要求很高并具有滞后性实现难度较大。$2 调制器免费下载

  资源简介：小数分频技术解决了锁相环频率合成器中的频率分辨率和转换时间的矛盾, 但是却引入了严重的相位噪声, 传统的相位补偿方法由于对A&ouml D 等数字器件的要求很高并具有滞后性实现难度较大。$2 调制器对噪声具有整形的功 能, 因而将多阶的$2 调制器用于小数分频...

  标签： ouml 小数分频 锁相环 转换

  上传时间： 2017-01-04

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• 如何调试锁相环频率合成器-6页-0.1M.pdf免费下载

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  标签： 0.1 调试 锁相环

  上传时间： 2013-05-18

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• 锁相环频率合成器-张厥盛-260页-10.9M.pdf免费下载

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  标签： 10.9 260 锁相环

  上传时间： 2013-04-24

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• 如何调试锁相环频率合成器 6页 0.1M.pdf免费下载

  资源简介：数字处理及显示技术专辑 106册 913M如何调试锁相环频率合成器 6页 0.1M.pdf

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  上传时间： 2014-05-05

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• 锁相环频率合成器 张厥盛 260页 10.9M.pdf免费下载

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  上传时间： 2014-05-05

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• 如何调试锁相环频率合成器免费下载

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  标签： 调试 锁相环 频率合成器

  上传时间： 2013-08-05

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• 锁相环频率合成器 张厥盛免费下载

  资源简介：锁相环频率合成器 张厥盛

  标签： 锁相环 频率合成器

  上传时间： 2013-05-15

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• 如何调试锁相环频率合成器免费下载

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  标签： 调试 锁相环 频率合成器

  上传时间： 2013-06-24

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• 锁相环频率合成器 张厥盛免费下载

  资源简介：锁相环频率合成器 张厥盛

  标签： 锁相环 频率合成器

  上传时间： 2013-04-15

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• 锁相环频率合成器(Motorola 集成电路应用技术丛书)免费下载

  资源简介：·锁相环频率合成器(Motorola 集成电路应用技术丛书)

  标签： Motorola nbsp 锁相环 应用技术

  上传时间： 2013-04-24

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• 锁相环频率合成器(Motorola 集成电路应用技术丛书)免费下载

  资源简介：·锁相环频率合成器(Motorola 集成电路应用技术丛书)

  标签： Motorola nbsp 锁相环 应用技术

  上传时间： 2013-05-27

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• 基于ADF4111的锁相环频率合成器设计免费下载

  资源简介：为得到性能优良、符合实际工程的锁相环频率合成器，提出了一种以ADI的仿真工具ADIsimPLL为基础，运用ADS（Advanced Design System 2009）软件的快速设计方法。采用此方法设计了频率输出为930~960 MHz的频率合成器。结果表明该频率合成器的锁定时间、相位噪声...

  标签： 4111 ADF 锁相环 频率合成器

  上传时间： 2013-12-16

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• 锁相环频率合成器-ad9850激励免费下载

  资源简介：用ad9850激励的锁相环频率合成器山东省济南市M0P44 部队Q04::00R 司朝良摘要! 提出了一种ad9850和ad9850相结合的频率合成方案! 介绍了ad9850芯片ad9850的基本工作原理" 性能特点及引脚功能! 给出了以1!2345 作为参考信号源的锁相环频率合成器实例! 并对该频率...

  标签： 9850 ad 锁相环 激励

  上传时间： 2013-10-18

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• 数字鉴相器,数字锁相环频率合成系统FPGA的实现,很有借鉴价值免费下载

  资源简介：数字鉴相器,数字锁相环频率合成系统FPGA的实现,很有借鉴价值

  标签： FPGA 数字 价值 鉴相器

  上传时间： 2017-01-07

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• 用AD9850激励的锁相环频率合成器免费下载

  资源简介：0387、用AD9850激励的锁相环频率合成器

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  上传时间： 2014-04-09

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• 摩托罗拉集成电路应用丛书：锁相环频率合成器（中文）.pdf免费下载

  资源简介：锁相技术相关专辑 38册 209M摩托罗拉集成电路应用丛书：锁相环频率合成器（中文）.pdf

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  上传时间： 2014-05-05

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• 如何调试锁相环频率合成器 6页 0.1M.pdf免费下载

  资源简介：锁相技术相关专辑 38册 209M如何调试锁相环频率合成器 6页 0.1M.pdf

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  上传时间： 2014-05-05

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• 0387、用AD9850激励的锁相环频率合成器.rar免费下载

  资源简介：锁相技术相关专辑 38册 209M0387、用AD9850激励的锁相环频率合成器.rar

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  上传时间： 2014-05-05

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• 锁相环频率合成器 张厥盛 260页 10.9M.pdf免费下载

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  标签：

  上传时间： 2014-05-05

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• 智能全数字锁相环的设计用VHDL语言在CPLD上实现串行通信免费下载

  资源简介：智能全数字锁相环的设计用VHDL语言在CPLD上实现串行通信

  标签： VHDL CPLD 全数字 串行通信

  上传时间： 2014-01-07

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• 频率合成技术是现代通信的重要组成部分,它是将一个高稳定度和高准确度的基准频率经过四则运算,产生同样稳定度和准确度的任意频率。随着大规模集成电路的发展,利用锁相环频率合成技术研制出了很多频率合成集成电路免费下载

  资源简介：频率合成技术是现代通信的重要组成部分,它是将一个高稳定度和高准确度的基准频率经过四则运算,产生同样稳定度和准确度的任意频率。随着大规模集成电路的发展,利用锁相环频率合成技术研制出了很多频率合成集成电路。其中,以摩托罗拉公司的MC14515x－2系列较为...

  标签： 频率合成技术 频率 集成电路 现代通信

  上传时间： 2017-04-27

  上传用户：mhp0114

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  标签： 频率合成技术 频率 集成电路 现代通信

  上传时间： 2014-01-11

  上传用户：xiaoxiang

• PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), Fo(Q5)是本地输出频率. 目的是从输入数据中提取时钟信号(Q5), 其频率与数据速率一致, 时钟上升沿锁定在数据的上升和下降沿免费下载

  资源简介：PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), Fo(Q5)是本地输出频率. 目的是从输入数据中提取时钟信号(Q5), 其频率与数据速率一致, 时钟上升沿锁定在数据的上升和下降沿上；顶层文件是PLL.GDF

  标签： 数据 Q5 PLL 输入

  上传时间： 2014-06-08

  上传用户：daguda

• PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), 数字锁相技术在通信领域应用非常广泛免费下载

  资源简介：PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), 数字锁相技术在通信领域应用非常广泛，本例用VHDL描述了一个锁相环作为参考，源码已经调试过。编译器synplicty.Fo(Q5)是本地输出频率. 目的是从输入数据中提取时钟信号(Q5), 其频率与数据速率一致,...

  标签： PLL 数字锁相环 接收 数字

  上传时间： 2013-12-30

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• 基于MC145159的PLL频率合成器设计与实现 介绍了锁相环路频率合成器的基本原理,分析了集成锁相环芯片M C 145159的工作特性,给出了集成锁相环芯片M C 145159的一个应用实例,为高免费下载

  资源简介：基于MC145159的PLL频率合成器设计与实现 介绍了锁相环路频率合成器的基本原理,分析了集成锁相环芯片M C 145159的工作特性,给出了集成锁相环芯片M C 145159的一个应用实例,为高频频率合成器的设计提供了一个较好的思路.测试结果证明了设计的合理性与实用性,系...

  标签： 145159 PLL 频率合成器 芯片

  上传时间： 2014-01-17

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• 针对高频感应加热电源中用传统的模拟锁相环跟踪频率所存在的问题,提出一种非常适合于高频感应加热的 新型的数字锁相环。使用FPGA 内底层嵌入功能单元中的数字锁相环74HCT297 ,并添加少量的数字电免费下载

  资源简介：针对高频感应加热电源中用传统的模拟锁相环跟踪频率所存在的问题,提出一种非常适合于高频感应加热的 新型的数字锁相环。使用FPGA 内底层嵌入功能单元中的数字锁相环74HCT297 ,并添加少量的数字电路来实现。最后利 用仿真波形验证该设计的合理性和有效性。整...

  标签： FPGA 297 HCT 高频感应

  上传时间： 2014-01-10

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• 该程序实现的功能是数字锁相环的设计。源代码可以直接进行仿真试验◎免费下载

  资源简介：该程序实现的功能是数字锁相环的设计。源代码可以直接进行仿真试验◎

  标签： 程序 数字锁相环 仿真试验 源代码

  上传时间： 2016-08-11

  上传用户：璇珠官人

• PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), Fo(Q5)是本地输出频率. 目的是从输入数据中提取时钟信号(Q5), 其频率与数据速率一致, 时钟上升沿锁定免费下载

  资源简介：PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), Fo(Q5)是本地输出频率. 目的是从输入数据中提取时钟信号(Q5), 其频率与数据速率一致, 时钟上升沿锁定在数据的上升和下降沿上； 顶层文件是PLL.GDF

  标签： Q5 数据 PLL 输入

  上传时间： 2017-07-24

  上传用户：璇珠官人

• 用数字锁相环电路实现高精度宽范围频率控制.pdf免费下载

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  上传时间： 2014-05-05

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