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半塞孔

  • 级联滤波器的优化设计

    级联滤波器的优化设计,用于绘制优化滤波器cic 半带

    标签: 级联 滤波器 优化设计

    上传时间: 2015-06-24

    上传用户:yzy6007

  • 多线程程序作为一种多任务、并发的工作方式

    多线程程序作为一种多任务、并发的工作方式,有以下的优点:   1) 提高应用程序响应。这对图形界面的程序尤其有意义,当一个操作耗时很长时,整个系统都会等待这个操作,此时程序不会响应键盘、鼠标、菜单的操作,而使用多线程技术,将耗时长的操作(time consuming)置于一个新的线程,可以避免这种尴尬的情况。   2) 使多CPU系统更加有效。操作系统会保证当线程数不大于CPU数目时,不同的线程运行于不同的CPU上。   3) 改善程序结构。一个既长又复杂的进程可以考虑分为多个线程,成为几个独立或半独立的运行部分,这样的程序会利于理解和修改。

    标签: 多线程 多任务 程序 工作方式

    上传时间: 2013-12-02

    上传用户:nanshan

  • 实验课的作业

    实验课的作业,包括半加器、全加器、加/减法器,使用逻辑图和VHDl描述,包括分析和报告。

    标签: 实验

    上传时间: 2013-12-25

    上传用户:从此走出阴霾

  • 这是一个测试Hibernate框架的java小程序。当初学习的时候

    这是一个测试Hibernate框架的java小程序。当初学习的时候,还有点一直半解,现在看来,已经基本掌握了

    标签: Hibernate java 测试 程序

    上传时间: 2013-12-24

    上传用户:Zxcvbnm

  • 可以将以bit为单位进行处理的算法扩展到8位

    可以将以bit为单位进行处理的算法扩展到8位,即以Byte为单位进行处理。由于有8个bit,所以有2^8种选择。这样明显会使运行时 间大为减少,速度明显更快,但是也有它的缺点,即,占用资源太大,所以综合考虑速度和 资源两点,采用半字节查表法。即以半 Byte为单位进行处理。由于有4个bit,所以有2^4种选择。

    标签: bit 8位 单位 算法

    上传时间: 2014-12-20

    上传用户:小宝爱考拉

  • 用VHDL结构描述设计一全减器

    用VHDL结构描述设计一全减器,全减器可由两个半减器和一个或门组成。

    标签: VHDL

    上传时间: 2013-12-22

    上传用户:思琦琦

  • 超宽带系统链路matlab仿真程序 超宽带系统简单仿真平台

    超宽带系统链路matlab仿真程序 超宽带系统简单仿真平台,有简单界面.包括可替换的脉冲成型(半余弦脉冲)、IEEE802.15.3a的修正SV信道、最大似然信道估计、Rake接收机等模块,可以实现monte carlo仿真求误码率。可添加多址接入、编码等功能(维特比编解码、帧同步的程序由本人同学编写)。入口主程序uwbsim.m 编解码程序:bin2deci.m;bini2deci.m;deci2bin.m VITRBI.m 信道及信道估计:ch_est.m;channel.m;channelgenerator.m;conv_m. m;sigfold.m UWB_SV_channel.m uwb_sv_cnvrt_ct.m uwb_sv_eval_ct.m uwb_sv_model_ct.m uwb_sv_params.m Rake接收机:findpeak.m;MRC_combine.m;MRC_Rake.m;n_upsample.m;selectpath.m 其他:cnv_encd.m;dssignal.m;Eb_halfcos.m;waveshape.m;halfcos_generator.m;metric.m;nxt_stat.m;sim_main.m;spreadgren.m;test_code.m;training_ds.m;uwbsim.m;vit_test.m

    标签: matlab 超宽带系统 仿真程序 仿真平台

    上传时间: 2013-12-30

    上传用户:duoshen1989

  • vc源代码 一个木马的客户端和服务端 要小心啊

    vc源代码 一个木马的客户端和服务端 要小心啊,是半个病毒 一般的防火墙 会发现的

    标签: 源代码 木马 服务端

    上传时间: 2014-12-07

    上传用户:zhaoq123

  • 一个汇编写的锁相环程序

    一个汇编写的锁相环程序,直接用来控制国半的LMX1601芯片,也可参考控制其它PLL IC

    标签: 汇编 锁相环 程序

    上传时间: 2015-08-22

    上传用户:PresidentHuang

  • 数字系统设计实例.pdf,VHDL语言实现

    数字系统设计实例.pdf,VHDL语言实现,7.1 半整数分频器的设计7.2 音乐发生器7.3 2FSK/2PSK信号产生器7.4 实用多功能电子表7.5 交通灯控制器 7.6 数字频率计.值得一看。

    标签: VHDL 数字系统 设计实例

    上传时间: 2015-08-31

    上传用户:lhw888