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VHDL/FPGA/Verilog 用于FPGA的huffman算法的HDL编码

用于FPGA的huffman算法的HDL编码，包括VHDL及Verilog代码。可用于JPEG及MPEG压缩算法。

https://www.eeworm.com/dl/663/344123.html

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VHDL/FPGA/Verilog 用于FPGA的量化算法的HDL编码

用于FPGA的量化算法的HDL编码，包括VHDL及Verilog代码。可用于JPEG及MPEG压缩算法。

https://www.eeworm.com/dl/663/344127.html

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FPGA HDL 量化算法编码

VHDL/FPGA/Verilog 6级流水

6级流水，verilog实现浮点数的加法，其中浮点数格式符合IEEE754标准

https://www.eeworm.com/dl/663/355234.html

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VHDL/FPGA/Verilog 从MIC输入一段音频然后

从MIC输入一段音频然后，再从AOUT的接口播放出来的verilog 的代码

https://www.eeworm.com/dl/663/364641.html

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MIC 输入音频

VHDL/FPGA/Verilog 伪随机序列产生器－filtered 代进位反馈移位寄存器

伪随机序列产生器－filtered 代进位反馈移位寄存器，verilog hdl 原代码。

https://www.eeworm.com/dl/663/374707.html

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filtered 伪随机序列产生器进位

VHDL/FPGA/Verilog 本实验实现一个能显示小时

本实验实现一个能显示小时，分钟，秒的数字时钟（贝一特电子）Verilog源码

https://www.eeworm.com/dl/663/404166.html

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实验

其他  十字路口交通灯控制:分为主路和辅路

十字路口交通灯控制:分为主路和辅路，由verilog实现

https://www.eeworm.com/dl/534/465070.html

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十字路口交通灯控制分

技术资料  基于CPLD器件的线型CCD东芝TCD1501的驱动程序

基于CPLD器件的线型CCD东芝TCD1501的驱动程序，用verilog语言开发。

https://www.eeworm.com/dl/834054.html

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cpld ccd tcd1501

技术资料  基于FPGA嵌入式系统设计（第二版）配套代码

《基于FPGA嵌入式系统设计》（第二版）的配套代码，verilog编写带工程。

https://www.eeworm.com/dl/839164.html

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fpga 嵌入式系统

技术资料  串口通信

串口通信的VERILOG实现，能帮助大家学习和实验研究的完成，希望能提供帮助

https://www.eeworm.com/dl/910868.html

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串口通信

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