以Altera公司的Quartus Ⅱ 7.2作为开发工具，研究了基于FPGA的DDS IP核设计，并给出基于Signal Tap II嵌入式逻辑分析仪的仿真测试结果。将设计的DDS IP核封装成为SOPC Builder自定义的组件，结合32位嵌入式CPU软核Nios II，构成可编程片上系统（SOPC），利用极少的硬件资源实现了可重构信号源。该系统基本功能都在FPGA芯片内完成，利用 SOPC技术，在一片 FPGA 芯片上实现了整个信号源的硬件开发平台，达到既简化电路设计、又提高系统稳定性和可靠性的目的。
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上传时间： 2013-11-05
上传用户：songkun
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上传时间： 2013-12-22
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上传时间： 2017-02-15
上传用户：dengzb84
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上传时间： 2022-04-21
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上传用户：lliuhhui
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上传时间： 2013-05-25
上传用户：teddysha
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上传时间： 2013-04-24
上传用户：siguazgb
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上传时间： 2014-12-31
上传用户：瓦力瓦力hong
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上传时间： 2013-07-05
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上传时间： 2013-06-28
上传用户：梧桐
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上传时间： 2015-11-04
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上传时间： 2015-12-21
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上传时间： 2016-02-19
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上传时间： 2013-12-20
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