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VerilogHDL数字设计与综合夏宇闻译(第二版)

  • 资源大小:12178 K
  • 上传时间: 2013-05-29
  • 上传用户:my_ov
  • 资源积分:2 下载积分
  • 标      签: VerilogHDL 数字设计

资 源 简 介

Verilog HDL是一种硬件描述语言(HDL:Hardware Discription Language),是一种以文本形式来描述数字系统硬件的结构和行为的语言,用它可以表示逻辑电路图、逻辑表达式,还可以表示数字逻辑系统所完成的逻辑功能。 Verilog HDL和VHDL是目前世界上最流行的两种硬件描述语言,都是在20世纪80年代中期开发出来的。前者由Gateway Design Automation公司(该公司于1989年被Cadence公司收购)开发。该书本由浅入深的介绍了该技术的相关知识。推荐阅读。

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